Navi 31は動作周波数がNavi 21より30%アップ
チップレット周りでもう1つ、プロセスそのものについて。Navi 31のGCDは5nmプロセスで製造されることになったが、これとNavi 21を比較したのが下の画像だ。
同一周波数なら50%消費電力削減、同一消費電力なら30%性能向上としているが、TSMCがもともと説明していた数字で言えばN7からN5に移行するとロジック密度が最大80%向上するほかに、最大15%の速度向上と30%の消費電力削減が実現できるとしていた。
もっとも製品スペックで比較すると以下のようになってしまい、平均して1割程度の向上しか見られない。
RDNA 2(Radeon RX 6950 XT) : Game 2.1GHz/Boost 2.3GHz
RDNA 3(Radeon RX 7900 XTX): Game 2.3GHz/Boost 2.5GHz
“30% improvement in STA”というからには、もう少し動作周波数の差があってもいい気がするのだが、現実問題としてはそこまでの差は見られないようだ。
ただRDNA 2とRDNA 3ではそもそも演算器の数が2倍では効かない。96CU vs 80CUながら、RDNA 3の方が実質2倍の演算器を実装していることを考えると2.4倍になる。
2.4倍の演算器をほぼ同等の消費電力でまわしながら、動作周波数が1割向上しているというのは冷静に考えればものすごい差であって、この原動力の1つがTSMCのN5の利用ということになる。
Ryzen 7000では動作周波数の高さと、これにともなう消費電力の高さが問題になったTSMCのN5だが(Ryzen 7000シリーズもECOモードで動作させると、ものすごく優秀な性能/消費電力比なのだが)、Navi 31ではうまく特性を引き出せたと言えるだろう。
1つには最大で2.5GHzと、GPUにしては高い動作周波数だが、CPUで見たらピークの半分くらいの消費電力効率の良いと言われるあたりで利用していることが挙げられるだろう。
ということでチップレット構造を説明していたらページが終わってしまった。次回はCUの中身を解説したい。
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